회로설계 취업 관련 질문

Q. 회로설계 취업 관련 질문

kkokokoka

안녕하십니까 저는 현재 4학년 2학기를 보내는 학생입니다. 다름이 아닌, 회로설계 분야에 관해 질문이 있습니다. 현재 스펙은 다음과 같습니다. 전체학점/전공학점 (3.96/4.1) , 전국 AI 반도체 설계 대회 장려상, intel FPGA교육 2주, TCAS-I (현제 under review, DRAM Sense amplifier) , 99년생이고 대학은 수도권 국립입니다. 학부는 전자공학과 입니다. 이정도 스펙의 경우, 회로 설계쪽으로의 취업이 될 수 있는지 궁굼합니다. 전문가 분들의 답변을 듣고싶어서 이렇게 질문을 올려봅니다.

2026.04.01

답변 3

탁
탁기사삼성전자
코사장 ∙ 채택률 78% ∙
회사
일치
채택된 답변
역량은 회설쪽이 무조건 맞습니다. 직무유관경험이 있어야 서류 및 면접에서 유리한데, 질문자님은 수상경력도 있으시고 학점도 높으신편에 속해서 회설 쓰셔야합니다 다만 회설이 공정쪽보다는 티오는 적고 요즘 계약학과로 많이채워집니다. 따라서 서류만 뚫으면 인적성 및 면접배수는 동일해서 첫 목표를 서류뚫는것으로 잡으시고 경험을 잘 정리하셔서 수치를 근거로들며 전문적으로 작성해보시는 것을 추천합니다.
2026.04.01
댓글 3
k
kokokoka
작성자
2026.04.01
virtuoso로 DRC, LVS로 오류 check 하고 pex 추출 후 hspice로 monte carlo 10k 돌리면서 , inverter 비율이라던가 clock feedthrough 같은 문제들을 확인하고 비율을 마추어 갔으며, layout시에 기존 pre-sim에서 보이던 skew 현상을 완화시켰습니다. 이런걸 바탕으로 작성해 나가면 서류 합격에 도움이 될까요? 또한 corner effect도 비교해보고, temperature도 room 기준(25도), 85도 testing 해보았습니다. 아직 tape out 경험은 전무입니다.
탁
탁기사삼성전자
2026.04.01
@kokokoka drc lvs는 검증파트가 따로있고 레이아웃도 파트가 배정돼있습니다. 학사분들은 디지털 베릴로그 검증쪽으로 많이가며 (논리회로 쪽) 클럭 맞추고 레이아웃 경험 당연히 모두 도움이됩니다.
k
kokokokakokokoka
작성자
2026.04.01
@탁기사 답변 감사드립니다. 혹시 논문이 accept가 된다면 서류통과 확률이 더욱 올라갈까요??
멘
멘토 지니KT
코이사 ∙ 채택률 67%
● 채택 부탁드립니다 ● 현재 스펙이면 회로설계 충분히 도전 가능한 수준입니다. 특히 DRAM 센스앰프 주제와 FPGA 경험은 방향성이 잘 맞습니다. 다만 합격을 가르는 것은 학점보다 실제 설계 이해도입니다. 회로 동작 원리를 설명할 수 있는지 시뮬레이션 결과를 어떻게 해석했는지가 핵심입니다. Cadence Spectre 같은 툴 경험이나 트랜지스터 레벨 분석을 보완하면 경쟁력이 크게 올라갑니다. 논문이나 프로젝트 하나를 깊게 파서 본인만의 설계 스토리를 만드는 것이 중요합니다.
2026.04.01
개
개미는오늘도뚠뚠삼성전자
코부사장 ∙ 채택률 73% ∙
회사
일치
안녕하세요 멘티님 취업준비로 고생많습니다. 질문에 대하여 답변드리자면, 현실적으로는 쉽지않습니다. 디지털인지 아날로그인진 알수없지만, 워낙 뽑는인원이적고 고스펙지원자들이 많다보니 실질적 경쟁률이 너무 높습니다. 차라리 많은 인원을 채용하는 직무로 입사하여 사내 잡포스팅제도를 이용하는것이 어떨까 싶네요
2026.04.01
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반도체
설계팀
대기업 반도체 산업으로 취업하기 위해선, 직관적 해석능력과 사고력이 필요합니다. 핵심 역량과 배운 지식을 취업에 활용하고 싶다면 국비지원 강의를 추천합니다.

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탁

탁기사삼성전자

코사장 ∙ 채택률 78% ∙

회사

일치

채택된 답변

역량은 회설쪽이 무조건 맞습니다. 직무유관경험이 있어야 서류 및 면접에서 유리한데, 질문자님은 수상경력도 있으시고 학점도 높으신편에 속해서 회설 쓰셔야합니다 다만 회설이 공정쪽보다는 티오는 적고 요즘 계약학과로 많이채워집니다. 따라서 서류만 뚫으면 인적성 및 면접배수는 동일해서 첫 목표를 서류뚫는것으로 잡으시고 경험을 잘 정리하셔서 수치를 근거로들며 전문적으로 작성해보시는 것을 추천합니다.

kokokoka

작성자

2026.04.01

virtuoso로 DRC, LVS로 오류 check 하고 pex 추출 후 hspice로 monte carlo 10k 돌리면서 , inverter 비율이라던가 clock feedthrough 같은 문제들을 확인하고 비율을 마추어 갔으며, layout시에 기존 pre-sim에서 보이던 skew 현상을 완화시켰습니다. 이런걸 바탕으로 작성해 나가면 서류 합격에 도움이 될까요? 또한 corner effect도 비교해보고, temperature도 room 기준(25도), 85도 testing 해보았습니다. 아직 tape out 경험은 전무입니다.

탁

탁기사삼성전자

2026.04.01

@kokokoka drc lvs는 검증파트가 따로있고 레이아웃도 파트가 배정돼있습니다. 학사분들은 디지털 베릴로그 검증쪽으로 많이가며 (논리회로 쪽) 클럭 맞추고 레이아웃 경험 당연히 모두 도움이됩니다.

kokokokakokokoka

작성자

2026.04.01

@탁기사 답변 감사드립니다. 혹시 논문이 accept가 된다면 서류통과 확률이 더욱 올라갈까요??

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